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Caractéristiques de débogage: | JTAG, balayage des limites, programmation interne au système | GESTION DE PUISSANCE: | Réduction dynamique de la puissance, Réinitialisation à la mise sous tension |
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Outils de conception: | Quartus Prime | Plage de tension: | 1.2V à 5.5V |
Fonctionnalités de sécurité: | AES, SHA, RSA | Goupilles d'entrée-sortie: | Jusqu'à 1,000 |
Gestion d'horloge: | L'établissement doit fournir les informations suivantes à l'autorité compétente: | Interfaces: | PCI |
Types de paquet: | QFP, BGA, LGA | Cellules logiques: | Jusqu'à 100,000 |
Fréquence de fonctionnement: | Jusqu'à 500 mégahertz | Plage de températures: | -40°C à 125°C |
Mémoire incluse: | EEPROM, Flash, SRAM | La mémoire: | Jusqu' à 10 Mo |
Mettre en évidence: | Virtex FPGA Field Programmable Gate Array,Réseau de portes logiques programmables UltraScale+,XCVU9P-2FLGB2104I |
Attribut | Valeur |
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Caractéristiques de débogage | JTAG, balayage des limites, programmation interne au système |
Gestion de l'énergie | Réduction dynamique de la puissance, réinitialisation de l'alimentation |
Outils de conception | Quartus Prime, Vivado, Libero, qui est le nom du groupe. |
Plage de tension | 1.2V à 5.5V |
Caractéristiques de sécurité | AES, SHA, RSA |
Pins d'entrée/sortie | Jusqu'à 1,000 |
Gestion de l'horloge | Le montant de l'aide est calculé en fonction de l'expérience acquise. |
Interfaces | Pour les appareils électroniques |
Types de colis | Les produits de la catégorie 1 doivent être présentés dans la catégorie 1 de la présente annexe. |
Cellules logiques | Jusqu'à 100,000 |
Fréquence de fonctionnement | Jusqu'à 500 MHz |
Plage de température | -40°C à 125°C |
Mémoire intégrée | Les données de base doivent être utilisées pour les données de base. |
La mémoire | Jusqu'à 10 Mb |
FPGA XCVU9P-2FLGB2104I Porte programmable sur le terrain
L'architecture Xilinx® UltraScaleTM comprend des familles FPGA, MPSoC et RFSoC de haute performance, couvrant un large éventail d'exigences système.Réduire la consommation d'énergie globale grâce à de nombreuses technologies innovantes.
Les FPGA Kintex® UltraScale:FPGA à haute performance, mettant l'accent sur le rapport prix/performance, utilisant une technologie à puce unique et à interconnexion en silicium empilé (SSI) de nouvelle génération.Rapport DSP et RAM à logique élevé ainsi que les émetteurs-récepteurs de nouvelle génération, combinés à des emballages peu coûteux, permettent d'obtenir le meilleur équilibre entre performance et coût.
Les FPGA Kintex UltraScale+TM sont les suivants:Améliorer les performances et la mémoire UltraRAM sur la puce pour réduire les coûts de BOM.Kintex UltraScale+ FPGA offre une variété d'options d'alimentation, permettant le meilleur équilibre entre les performances du système requises et la consommation d'énergie minimale.
Virtex® UltraScale FPGA:Un FPGA de haute capacité et haute performance mis en œuvre en utilisant des technologies SSI à puce unique et de nouvelle génération.la bande passante et les performances en intégrant diverses fonctions au niveau du système pour répondre aux demandes des marchés et des applications critiques;.
Disponible dans l'architecture UltraScale. Virtex UltraScale + FPGA offre également de nombreuses options d'alimentation, offrant le meilleur équilibre entre les performances du système et la consommation d'énergie minimale.
Les MPSoC de Zynq® UltraScale+ sont les suivants:un processeur d'application 64 bits à haute performance et à faible consommation basé sur ARM® v8 Cortex®-A53 combiné au processeur en temps réel ARM Cortex-R5 et à l'architecture UltraScale,Il a créé les premiers MPSoC programmables complets du secteur.Offrir des effets d'économie d'énergie sans précédent, un traitement hétérogène et une accélération programmable.
Les RFSoC Zynq® UltraScale+ sont équipés:Intégration des sous-systèmes de conversion de données RF et de la correction d'erreur avant avec une logique programmable de pointe et des capacités de traitement hétérogènes.Il intègre un convertisseur RF analogique-numérique (RF-ADC), le convertisseur RF numérique-analogique (RF-DAC) et la correction de l'erreur de décision en avant souple (SD-FEC) pour fournir un sous-système clé pour les infrastructures de radio cellulaire et câblée multiband et multimode.
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